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Title:
ハイブリッドトランザクショナルメモリシステムにおける並行処理の最大化
Document Type and Number:
Japanese Patent JP2017509970
Kind Code:
A
Abstract:
トランザクショナルメモリシステムの実施形態において、装置は、プロセッサと実行ロジックとを備える。実行ロジックは、第１のソフトウェアトランザクションモードの少なくとも１つの第１のソフトウェアトランザクション、および、第２のソフトウェアトランザクションモードの第２のソフトウェアトランザクション、および、第１のハードウェアトランザクションモードの少なくとも１つのハードウェアトランザクション、および、第２のハードウェアトランザクションモードの少なくとも１つの第２のハードウェアトランザクションの並列実行を可能とする。一例を挙げると、実行ロジックはプロセッサ内で実装されるとしてよい。他の実施形態も説明および請求する。

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Inventors:
Calciu, Irina
Gotchurich, Justin Yi.
Spaceman, Tatiana
Pocom, Gilles A.
Application Number:
JP2016551272A
Publication Date:
April 06, 2017
Filing Date:
March 25, 2015
Export Citation:
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Assignee:
INTEL CORPORATION
International Classes:
G06F9/46; G06F9/52
Domestic Patent References:
JP2013513888A2013-04-22
JP2001527242A2001-12-25
JP2013513888A2013-04-22
JP2001527242A2001-12-25
Foreign References:
US20100332765A12010-12-30
US20100332765A12010-12-30
Other References:
田村祐典ほか: "組込システムにおけるソフトウェアトランザクションメモリの検討", 情報処理学会研究報告 平成２１年度▲６▼ ［ＤＶＤ−ＲＯＭ］, JPN6017030281, 27 March 2010 (2010-03-27), JP, pages １−７ページ
田村祐典ほか: "組込システムにおけるソフトウェアトランザクションメモリの検討", 情報処理学会研究報告 平成２１年度▲６▼ ［ＤＶＤ−ＲＯＭ］, JPN6017030281, 27 March 2010 (2010-03-27), JP, pages １−７ページ
Attorney, Agent or Firm:
Longhua International Patent Service Corporation



 
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