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Title:
クロスカップリングノイズ低減を伴う装置、方法、およびシステム
Document Type and Number:
Japanese Patent JP2018500824
Kind Code:
A
Abstract:
実施例は、回路におけるクロスカップリングノイズ低減を伴う装置、方法、およびシステムを含む。実施例において、回路は、コモンインダクタと、第1インダクタと第1負荷および第2負荷との間に接続されたネガティブ結合インダクタペアとを含んでよい。ネガティブ結合インダクタペアは第1および第2インダクタを含む。第1インダクタは第1負荷に対して接続または結合されてよく、かつ、第2インダクタは第2負荷に対して接続または結合されてよく、第1負荷と第2負荷との間のクロスカップリングノイズを低減する。回路を実装するために使用されるパッシブ構造の例も記述される。他の実施例も、また、記述かつ請求され得る。

Inventors:
ジャイン,アミット ケイ.
シェカール,サミール
Application Number:
JP2017531285A
Publication Date:
January 11, 2018
Filing Date:
November 16, 2015
Export Citation:
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Assignee:
インテル コーポレイション
International Classes:
H03H7/01
Attorney, Agent or Firm:
伊東 忠重
伊東 忠彦
大貫 進介