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Title:
メモリ制御装置及びメモリ制御方法
Document Type and Number:
Japanese Patent JPWO2006132006
Kind Code:
A1
Abstract:
アクセス回路30,40から発行されたアクセス要求を調停回路20で調停して記憶装置10にアクセスする一方、アクセス回路30,40から発行されたアクセス要求を調停回路21で調停して記憶装置11にアクセスする。

Inventors:
Takuto Tanaka
Tetsuji Mochida
Application Number:
JP2007520026A
Publication Date:
January 08, 2009
Filing Date:
December 26, 2005
Export Citation:
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Assignee:
Matsushita Electric Industrial Co., Ltd
International Classes:
G06F12/00
Domestic Patent References:
JP2003263363A2003-09-19
JP2002500395A2002-01-08
JP2000132503A2000-05-12
JPS61256458A1986-11-14
JPS63175964A1988-07-20
JPH01231145A1989-09-14
JP2000187615A2000-07-04
JPH01169565A1989-07-04
JPH03212754A1991-09-18
Foreign References:
WO2004029816A22004-04-08
Attorney, Agent or Firm:
Hiroshi Maeda
Hiroshi Takeuchi
Takahisa Shimada
Yuji Takeuchi
Katsumi Imae
Atsushi Fujita
Kazunari Ninomiya
Tomoo Harada
Iseki Katsumori
Seki Kei
Yasuya Sugiura