Title:
分周回路、デマルチプレクサ回路、及び半導体集積回路
Document Type and Number:
Japanese Patent JPWO2017154191
Kind Code:
A1
Abstract:
第１のクロック信号を分周して第１の分周クロック信号を生成する第１の分周回路部（１０）と、第１のクロック信号と同じ周波数で第１の位相差を有する第２のクロック信号を分周して第２の分周クロック信号を生成する第２の分周回路部（２０）と、第１の分周クロック信号と前記第２の分周クロック信号との間の位相関係を検出する検出回路（３０）と、第２の分周回路部により生成される第２の分周クロック信号及び第２の分周クロック信号の反転信号の一方を選択し出力する選択回路（５０）とを有する。選択回路が、検出回路により検出された第１の分周クロック信号と前記第２の分周クロック信号との間の位相関係に基づいて、第２の分周クロック信号及び第２の分周クロック信号の反転信号の一方を選択し出力することで、第１の分周クロック信号に対して所望の位相関係を保持した、第２のクロック信号に基づく分周クロック信号を生成し出力することを可能にする。
Inventors:
Tatsuya Sakie
Hideki Kano
Hideki Kano
Application Number:
JP2018503958A
Publication Date:
January 17, 2019
Filing Date:
March 11, 2016
Export Citation:
Assignee:
Socionext Inc.
International Classes:
H03K23/00; H03K23/42
Domestic Patent References:
| JPH02194721A | 1990-08-01 | |||
| JP2008011132A | 2008-01-17 |
Foreign References:
| WO2010097846A1 | 2010-09-02 |
Attorney, Agent or Firm:
Takayoshi Kokubun
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