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Title:
低読み出し電力を備えたメモリシステム
Document Type and Number:
Japanese Patent JP6389925
Kind Code:
B1
Abstract:
【課題】低読み出し電力を備えたメモリシステムを提供する。【解決手段】メモリシステムは、第1メモリバンクMBAと、第1経路セレクタYP1と、第2メモリバンクMBBと、第2経路セレクタYP2と、検知装置100とを含む。第1メモリバンクは、複数の第1メモリセルMCA(M、N)を含む。第2メモリバンクは、複数の第2メモリセルMCB(M、N)を含む。第1経路セレクタは、複数の第1ビットラインBLA1〜BLANを介して複数の第1メモリセルに結合された複数の入力端子と、2つの出力端子とを含む。第2経路セレクタは、複数の第2ビットラインを介して複数の第2メモリセルに接続された複数の入力端子と、2つの出力端子とを含む。検知装置は、必要な動作に応じて、第1バンクセレクタ及び第2バンクセレクタの出力端子が結合されており、基準電流源と2つのバンクセレクタの端子のうちの2つから出力される電流の差を検出する。【選択図】図1

Inventors:
Kure Kashiwa Kei
Application Number:
JP2017109618A
Publication Date:
September 12, 2018
Filing Date:
June 02, 2017
Export Citation:
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Assignee:
eMemory Technology Inc.
International Classes:
G11C7/10; G11C7/06; G11C8/12; G11C16/28
Domestic Patent References:
JPH11288600A1999-10-19
JP2013251035A2013-12-12
JPH11288600A1999-10-19
JP2013251035A2013-12-12
JPH778465A1995-03-20
JPH773663A1995-03-17
JPH4216400A1992-08-06
JPH778465A1995-03-20
JPH773663A1995-03-17
JPH4216400A1992-08-06
Attorney, Agent or Firm:
Tadashige Ito
Tadahiko Ito
Shinsuke Onuki